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          Cadence納米集成電路設計新技術培訓班
   入學要求

        學員學習本課程應具備下列基礎知識:
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       為了保證培訓效果,增加互動環節,我們堅持小班授課,每期報名人數限3到5人,多余人員安排到下一期進行。
   上課時間和地點
上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
近開課時間(周末班/連續班/晚班)
Cadence納米班:2025年5月19日....--即將開課--............................
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     ☆資深工程師授課

        ◆外地學員:代理安排食宿(需提前預定)
        ☆注重質量
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        1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
        2、培訓結束后免費提供半年的技術支持,充分保證培訓后出效果;
        3、培訓合格學員可享受免費推薦就業機會。 。專注高端培訓17年,曙海提供的課程得到本行業的廣泛認可,學員的能力得到大家的認同,受到用人單位的廣泛贊譽。

          Cadence納米集成電路設計新技術培訓班

1, What’s Hot and New about IC?
2, Solve your Custom Design Challenges with Cadence Virtuoso? platform
3, OpenAccess database
4, Introduction to IC61
4, Simulation & Verification
5, Silicon Analysis
6, Digital IC Part I: Front-End (Logic) Design with Cadence Logic Design Team solution
7, Chip Planning Solutions with CPS
8, Conformal Products Update
9, Design for Test with RC/Test Update
10, Design for Low Power with RC/CPF
11, Digital IC Part II: Physical Implementation with Cadence Encounter? platform
? LP implementation with CPF
? Digital Mixed Signal Design using EDI
? Advanced Technology for 32nm and below
? Digital GHz Designs with over 100 MGates
12, Packaging Design with Cadence Allegro? PCB and Packaging Design Solution
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? IC Packaging Basics
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? System in Packaging (SiP) Development
? What’s SiP
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13, Enterprise Plan-to-Closure Methodology based on Cadence Incisive? Platform
? Enterprise Manager
? VIP Portfolio
? Verification Acceleration and Emulation

 

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.(2012年12月17日........,,,...........................................)...............................................................
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